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无线通信FPGA设计Matlab Verilog代码\05805\matlab代码\matlab\c10\c.mat
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..................................\.....\..........\......\...\frame_syn.m
..................................\.....\..........\......\...\PLLC.m
..................................\.....\..........\......\...\RRCrece.m
..................................\.....\..........\......\...\RRCsend.m
..................................\.....\..........\......\...\symbol_syn.m
..................................\.....\..........\......\..1\adpeq.m
..................................\.....\..........\......\...\ante.m
..................................\.....\..........\......\...\FFTlms.m
..................................\.....\..........\......\...\lms.m
..................................\.....\..........\......\...\RLS.m
..................................\.....\..........\......\...\signlms.m
..................................\.....\..........\......\...\WHT.m
..................................\.....\..........\......\...\WHTlms.m
..................................\.....\..........\......\..2\correce.m
..................................\.....\..........\......\...\matchfil.m
..................................\.....\..........\......\...\rake.m
..................................\.....\..........\......\..3\cell_search_cpich.m
..................................\.....\..........\......\...\ovsf.m
..................................\.....\..........\......\...\scramble.m
..................................\.....\..........\......\...\wcdmasource.m
..................................\.....\..........\......\.6\impinvar_bilinear.m
..................................\.....\..........\......\..\rcosflt_filter.m
..................................\.....\..........\......\..\rcosine_filter.m
..................................\.....\..........\......\.7\cicde.m
..................................\.....\..........\......\..\CICdec.m
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..................................\.....\..........\......\..\CICinterp.m
..................................\.....\..........\......\..\halfdec.m
..................................\.....\..........\......\..\halfinterp.m
..................................\.....\..........\......\..\hbfil.m
..................................\.....\..........\......\..\multirece.m
..................................\.....\..........\......\..\multisend.m
..................................\.....\..........\......\.8\ASKmod.m
..................................\.....\..........\......\..\F2T.m
..................................\.....\..........\......\..\LPF.m
..................................\.....\..........\......\..\MSKmod.m
..................................\.....\..........\......\..\OFDMmod.m
..................................\.....\..........\......\..\QAMmod.m
..................................\.....\..........\......\..\QPSKmod.m
..................................\.....\..........\......\..\T2F.m
..................................\.....\..........\......\.9\convcode.m
..................................\.....\..........\......\..\CRCcheck.m
..................................\.....\..........\......\..\encoderm.m
..................................\.....\..........\......\..\encode_bit.m
..................................\.....\..........\......\..\hamming7_4.m
..................................\.....\..........\......\..\intrlvcode.m
..................................\.....\..........\......\..\RScode.m
..................................\.....\..........\......\..\rsc_encode.m
..................................\.....\..........\......\..\TCMcode.m
..................................\.....\Verilog代码\6、7.doc
..................................\.....\...........\c10\10-2\mult.xco
..................................\.....\...........\...\....\mydds.xco
..................................\.....\...........\...\....\square_syn.v
..................................\.....\...........\...\...4\coastas_dds.v
.................................