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数字逻辑基础与Verilog设计
.........................\Readme.txt
.........................\Verilog_code
.........................\............\AppendixA
.........................\............\.........\figA_11.v
.........................\............\.........\figA_12.v
.........................\............\.........\figA_13.v
.........................\............\.........\figA_14.v
.........................\............\.........\figA_18.v
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.........................\............\.........\figA_43.v
.........................\............\.........\figA_5.v
.........................\............\.........\figA_6.v
.........................\............\.........\figA_7.v
.........................\............\.........\figA_9.v
.........................\............\Chapter10
.........................\............\.........\fig10_13.v
.........................\............\.........\fig10_19.v
.........................\............\.........\fig10_2.v
.........................\............\.........\fig10_28.v
.........................\............\.........\fig10_3.v
.........................\............\.........\fig10_40.v
.........................\............\.........\fig10_5.v
.........................\............\Chapter2
.........................\............\........\fig2_31.v
.........................\............\........\fig2_32.v
.........................\............\........\fig2_34.v
.........................\............\........\fig2_35.v
.........................\............\........\fig2_36.v
.........................\............\........\fig2_37.v
.........................\............\Chapter4
.........................\............\........\fig4_44.v
.........................\............\........\fig4_47.v
.........................\............\........\fig4_48.v
.........................\............\Chapter5
.........................\............\........\fig5_22.v
.........................\............\........\fig5_23.v
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.........................\............\........\fig5_34.v
.........................\............\........\fig5_41.