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Downloads SourceCode Embeded-SCM Develop VHDL-FPGA-Verilog
Title: seg_1 Download
  • Category:
  • VHDL-FPGA-Verilog
  • Tags:
  • File Size:
  • 5.6mb
  • Update:
  • 2018-03-25
  • Downloads:
  • 0 Times
  • Uploaded by:
  • 1Q84
 Description: Time module, digital tube display, format: time, minute, second
 Downloaders recently: [More information of uploader 1Q84]
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File list (Check if you may need any files): 
FilenameSizeDate
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