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Downloads SourceCode Embeded-SCM Develop VHDL-FPGA-Verilog
Title: ob4 Download
 Description: The realization of 0~99's cycle, pause, and zero function
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File list (Check if you may need any files):
FilenameSizeDate
ob4 0 2018-04-18
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ob4\iseconfig\ob44.xreport 20378 2018-04-18
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ob4\ob4.xst 1128 2018-04-11
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ob4\ob44.lso 6 2018-04-18
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ob4\ob44.syr 5137 2018-04-18
ob4\ob44.twr 4260 2018-04-18
ob4\ob44.twx 21596 2018-04-18
ob4\ob44.ucf 407 2018-04-11
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ob4\ob44.ut 393 2018-04-18
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ob4\ob44_pad.txt 27043 2018-04-18
ob4\ob44_par.xrpt 68990 2018-04-18
ob4\ob44_summary.html 5216 2018-04-18
ob4\ob44_summary.xml 409 2018-04-18
ob4\ob44_usage.xml 15942 2018-04-18
ob4\ob44_xst.xrpt 8590 2018-04-18
ob4\ob4_envsettings.html 9358 2018-04-11
ob4\ob4_summary.html 4160 2018-04-11
ob4\ob4_xst.xrpt 8585 2018-04-11
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ob4\planAhead_run_1\planAhead_run.log 4858 2018-04-11
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ob4\_xmsgs\ngdbuild.xmsgs 367 2018-04-18
ob4\_xmsgs\par.xmsgs 1729 2018-04-18
ob4\_xmsgs\pn_parser.xmsgs 744 2018-04-18

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