File list (Check if you may need any files):
LCD_Controller_Altera_MAX_II_CPLD_Design_Exampler
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.................................................\....\lcd_controller.v
.................................................\modelsim
.................................................\........\lcd_controller.cr.mti
.................................................\........\lcd_controller.mpf
.................................................\........\lcd_controller.v
.................................................\........\lcd_testbench.v
.................................................\........\transcript
.................................................\........\vsim.wlf
.................................................\........\wave.do
.................................................\........\work
.................................................\........\....\@u@f@m2
.................................................\........\....\.......\verilog.psm
.................................................\........\....\.......\_primary.dat
.................................................\........\....\.......\_primary.vhd
.................................................\........\....\@u@f@m2_altufm_parallel_bmm
.................................................\........\....\...........................\verilog.psm
.................................................\........\....\...........................\_primary.dat
.................................................\........\....\...........................\_primary.vhd
.................................................\........\....\divider
.................................................\........\....\.......\verilog.psm
.................................................\........\....\.......\_primary.dat
.................................................\........\....\.......\_primary.vhd
.................................................\........\....\fsm
.................................................\........\....\...\verilog.psm
.................................................\........\....\...\_primary.dat
.................................................\........\....\...\_primary.vhd
.................................................\........\....\lcd_controller
.................................................\........\....\..............\verilog.psm
.................................................\........\....\..............\_primary.dat
.................................................\........\....\..............\_primary.vhd
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.................................................\........\....\.............\verilog.psm
.................................................\........\....\.............\_primary.dat
.................................................\........\....\.............\_primary.vhd
.................................................\........\....\_info
.................................................\quartus
.................................................\.......\db
.................................................\.......\..\lcd_controller.asm.qmsg
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.................................................\.......\..\lcd_controller.cmp0.ddb
.................................................\.......\..\lcd_controller.dbp
.................................................\.......\..\lcd_controller.db_info
.................................................\.......\..\lcd_controller.eco.cdb
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