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FPGA开发板配套Verilog HDL代码\基础实验\8位优先编码器\.xhdl3.xref
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.............................\........\.............\encode.v.bak
.............................\........\.............\encode_assignment_defaults.qdf
.............................\........\乘法器\.xhdl3.xref
.............................\........\......\cmp_state.ini
.............................\........\......\db\mlt.asm.qmsg
.............................\........\......\..\mlt.cbx.xml
.............................\.....