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verilog-ethernet-master
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.......................\example
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.......................\.......\.....\....\fpga.ucf
.......................\.......\.....\....\fpga
.......................\.......\.....\....\....\Makefile
.......................\.......\.....\....\lib
.......................\.......\.....\....\...\eth
.......................\.......\.....\....\rtl
.......................\.......\.....\....\...\debounce_switch.v
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.......................\.......\.....\....\...\sync_signal.v
.......................\.......\.....\....\tb
.......................\.......\.....\....\..\arp_ep.py
.......................\.......\.....\....\..\axis_ep.py
.......................\.......\.....\....\..\eth_ep.py
.......................\.......\.....\....\..\gmii_ep.py
.......................\.......\.....\....\..\ip_ep.py
.......................\.......\.....\....\..\test_fpga_core.py
.......................\.......\.....\....\..\test_fpga_core.v
.......................\.......\.....\....\..\udp_ep.py
.......................\.......\DE5-Net
.......................\.......\.......\fpga
.......................\.......\.......\....\Makefile
.......................\.......\.......\....\README.md
.......................\.......\.......\....\common
.......................\.......\.......\....\......\altera.mk
.......................\.......\.......\....\cores
.......................\.......\.......\....\.....\Makefile
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.......................\.......\.......\....\.....\phy_reconfig.v
.......................\.......\.......\....\fpga.qsf
.......................\.......\.......\....\fpga.sdc
.......................\.......\.......\....\fpga
.......................\.......\.......\....\....\Makefile
.......................\.......\.......\....\lib
.......................\.......\.......\....\...\eth
.......................\.......\.......\....\rtl
.......................\.......\.......\....\...\debounce_switch.v
.......................\.......\.......\....\...\fpga.v
.......................\.......\.......\....\...\fpga_core.v
.......................\.......\.......\....\...\i2c_master.v
.......................\.......\.......\....\...\si570_i2c_init.v
.......................\.......\.......\....\...\sync_reset.v
.......................\.......\.......\....\...\sync_signal.v
.......................\.......\.......\....\tb
.......................\.......\.......\....\..\arp_ep.py
.......................\.......\.......\....\..\axis_ep.py
.......................\.......\.......\....\..\eth_ep.py
.......................\.......\.......\....\..\ip_ep.py
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.......................\.......\.......\....\..\udp_ep.py
.......................\.......\.......\....\..\xgmii_ep.py
.......................\.......\HXT100G
.......................\.......\.......\fpga
.......................\.......\.......\....\Makefile
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.......................\.......\.......\....\common
.......................\.......\.......\....\......\xilinx.mk
.......................\.......\.......\....\coregen
.......................\.......\.......\....\.......\Makefile
.......................\.......\.......\....\.......\coregen.cgp
.......................\.......\.......\....\.......\ten_gig_eth_