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[Other resource] an499_design_example DL : 0: cpld 控制 8-32M sdram 控制器 maxII epm570实现。
Update : 2008-10-13 Size : 422.86kb Publisher : 王可见
[Other resource] an499_CN DL : 0: cpld 控制 8-32M sdram 控制器 maxII epm570实现。 pdf 的说明文件
Update : 2008-10-13 Size : 188.02kb Publisher : 王可见
[Other] EPM570实验指导和使用说明 DL : 0: 此文档是CPLD EPM570 的详细学习文档，对从事veriolog编程的人员有很大的帮助！
Update : 2011-03-31 Size : 2.16mb Publisher : wanghong_4311@sina.com
[VHDL-FPGA-Verilog] motorcontrol_cpld DL : 0: 在ALTERA公司的EPM570上实现的电机脉冲算法，编码器反馈技术算法，已实际应用。-EPM570 in ALTERA
Update : 2025-02-17 Size : 1.12mb Publisher : Xinzhong.Ding
[VHDL-FPGA-Verilog] an499_design_example DL : 0: cpld 控制 8-32M sdram 控制器 maxII epm570实现。-CPLD control 8-32M sdram controller maxII epm570 realize.
Update : 2025-02-17 Size : 423kb Publisher : 王可见
[VHDL-FPGA-Verilog] an499_CN DL : 0: cpld 控制 8-32M sdram 控制器 maxII epm570实现。 pdf 的说明文件-CPLD control 8-32M sdram controller maxII epm570 realize. pdf documentation
Update : 2025-02-17 Size : 188kb Publisher : 王可见
[VHDL-FPGA-Verilog] epm570-2 DL : 0: cpld使用手册，相信芯片资料介绍，一本不可多得的资料说明-cpld manual, I believe that chip materials, a rare information
Update : 2025-02-17 Size : 836kb Publisher : feng
[VHDL-FPGA-Verilog] EPM570 DL : 0: 这是ATLREA的EPM570的一个144管脚CPLD的最小系统图，对于设计CPLD的板子有作用-This is the EPM570 ATLREA a minimum of 144 pin CPLD system diagram, for the design of the board has the role of CPLD
Update : 2025-02-17 Size : 333kb Publisher : yuanzengquan
[VHDL-FPGA-Verilog] JTAG_CPLD_project_1.pdf DL : 0: JTAG_CPLD_project source VHDL code ，适用于开发JTAG接口。此工程使用Altera EPM570 MAX II CPLD，包含硬件和软件描述。-JTAG_CPLD_project source VHDL code, suitable for the development of the JTAG interface. This project using the Altera EPM570 MAX II CPLD, includes hardware and software description.
Update : 2025-02-17 Size : 1.21mb Publisher : Jeff_Cai
[OS Develop] EPM570 DL : 0: 非常好的EPM570(CPLD)学习程序源码,适合初学者,能让其快速入门-Very good EPM570 (CPLD) learning program source code, suitable for beginners, allowing its Quick Start
Update : 2025-02-17 Size : 7.24mb Publisher : chen
[VHDL-FPGA-Verilog] sdr_sdram_epm570 DL : 0: CPLD芯片EPM570对SDRAM的读写操作，通过串口显示。-SDRAM write and read test based on CPLD chip-- EPM570.
Update : 2025-02-17 Size : 1.04mb Publisher : 黄成林
[VHDL-FPGA-Verilog] sdram_epm570_uart DL : 0: 基于CPLD芯片EPM570的verilog hdl串口程序-the UART verilog hdl code based on CPLD chip-- EPM570
Update : 2025-02-17 Size : 1.28mb Publisher : 黄成林
[VHDL-FPGA-Verilog] spi1 DL : 0: 使用verilog语言编写的实现cpld EPM570与EEPROM的SPI通信-Using verilog language to achieve cpld EPM570 SPI communication with the EEPROM
Update : 2025-02-17 Size : 2kb Publisher : LJL
[VHDL-FPGA-Verilog] decoder38 DL : 0: 38译码器源码VHDL版， cpld EPM570版-38 decoder VHDL source code version
Update : 2025-02-17 Size : 112kb Publisher : HAM
[VHDL-FPGA-Verilog] syn_cnter_4 DL : 0: 四位计数器，VHDL版，基于cpld EPM570芯片-The four bit counter, VHDL version, EPM570 chip based on CPLD
Update : 2025-02-17 Size : 154kb Publisher : HAM
[VHDL-FPGA-Verilog] example16-dac7512-sina-wave-ok DL : 0: VHDL 基于cpld EPM570的DA转换代码-VHDL CPLD EPM570 the DA conversion code based on
Update : 2025-02-17 Size : 278kb Publisher : HAM
[VHDL-FPGA-Verilog] 1705 DL : 0: 用于驱动东芝的CCD芯片 1705，硬件是EPM570(drive CCD 1705 from Toshiba)
Update : 2025-02-17 Size : 462kb Publisher : yymj