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[source in ebook] 256点FFT源代码 DL : 7: 256点FFT IP核。包括16bit和8bit两种精度和C、VHDL、Verilog三种语言的多版本、多精度的IP核
Update : 2009-10-19 Size : 344.11kb Publisher : ykletter@163.com
[source in ebook] 512点FFT DL : 2: 512点FFT IP核。包括C、VHDL和Verilog三种语言版本，8bit与16bit两种精度。
Update : 2009-10-19 Size : 401.12kb Publisher : ykletter@163.com
[Other] FFT16 DL : 0: 基于FPGA的16点FFT快速傅立叶变换的Verilog源代码。-the FFT implement of Verilog based on FPGA
Update : 2025-02-17 Size : 2kb Publisher : lsd
[VHDL-FPGA-Verilog] 2C35F672_FFT DL : 1: 在Altera芯片2C35F672平台上的FFT程序，采用DSPBuilder5.0，生成Verilog文件。开发环境：QuartusII5.0。-In the Altera chip 2C35F672 platform FFT procedures DSPBuilder5.0, generated Verilog file. Development Environment: QuartusII5.0.
Update : 2025-02-17 Size : 463kb Publisher : lovenevol
[VHDL-FPGA-Verilog] fft_IPcore DL : 0: 这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。
Update : 2025-02-17 Size : 8.32mb Publisher : 李杰
[VHDL-FPGA-Verilog] ip_fft128 DL : 0: 128点fft的IP核vhdl源代码，另有其控制代码。-128 point fft s IP core VHDL source code, while its control code.
Update : 2025-02-17 Size : 7kb Publisher : 戈立军
[Linux-Unix] Linux_bc DL : 0: 对vga接口做了详细的介绍，并且有一 ·三段式Verilog的IDE程序，但只有DMA ·电子密码锁，基于fpga实现，密码正 ·IIR、FIR、FFT各模块程序设计例程， ·基于逻辑工具的以太网开发，基于逻 ·自己写的一个测温元件（ds18b20）的 ·光纤通信中的SDH数据帧解析及提取的 ·VHDL Programming by Example（McGr ·这是CAN总线控制器的IP核，源码是由 ·FPGA设计的SDRAM控制器，有仿真代码 ·xilinx fpga 下的IDE控制器原代码, ·用verilog写的，基于查表法实现的LO ·精通verilog HDL语言编- up:in STD_LOGIC down:in STD_LOGIC run_stop:in STD_LOGIC wai_t: in std_logic_vector(2 downto 0) lift:in std_logic_vector(2 downto 0) ladd: out std_logic_vector(1 downto 0) ) end control
Update : 2025-02-17 Size : 17.82mb Publisher : liuzhou
[VHDL-FPGA-Verilog] fft_verilog DL : 0: FFT IP core 源码状态控制机-FFT IP core
Update : 2025-02-17 Size : 7kb Publisher : chris
[VHDL-FPGA-Verilog] FFT_verilog DL : 1: verilog实现的FFT变换，经硬件测试其功能与Altera的FFT IP核相近-verilog implementation FFT transform, through hardware, test its functionality with Altera' s FFT IP core similar to
Update : 2025-02-17 Size : 604kb Publisher : culun
[VHDL-FPGA-Verilog] FPGA_FFT DL : 0: 基于IP核的FPGA FFT算法模块的设计与实现在QUATUSII下实现-IP-based core module FPGA FFT algorithm design and implementation be achieved in QUATUSII
Update : 2025-02-17 Size : 217kb Publisher : linxing
[VHDL-FPGA-Verilog] pipelined_fft_64 DL : 0: 利用IP Core编写的Verilog程序，实现FFT变换，希望对大家有帮助。-Written using Verilog IP Core procedures to achieve FFT transformation, we want to help.
Update : 2025-02-17 Size : 97kb Publisher : chengyungang
[VHDL-FPGA-Verilog] fft_2011_3_23(COMPLETE-FFT1024) DL : 0: VERILOG FFT IP核调用，以及其控制文件-VERILOG FFT IP core call, as well as its control file
Update : 2025-02-17 Size : 20.01mb Publisher : 贾斌
[VHDL-FPGA-Verilog] FFT DL : 0: verilog 实现FFT IP核的控制，借鉴给需要学习的朋友-verilog achieve FFT IP core control, reference to the need to learn a friend
Update : 2025-02-17 Size : 11.56mb Publisher : 甘超
[Windows Develop] vFFT_veriloge DL : 0: verilog实现的FFT变换，经硬件测试其功能与AAltera的FFT IP核相近， -verilog realization of the FFT algorithm, its function is similar to the FFT IP AAltera the nuclear test by the hardware,
Update : 2025-02-17 Size : 605kb Publisher : magnet
[MPI] fft DL : 0: altera公司fft ip核的运用。语言是verilog.-Altera company s fft ip. Language verilog.
Update : 2025-02-17 Size : 11.42mb Publisher : shiyuan
[Software Engineering] FFTPVerilog DL : 1: FFT Verilog RTL 经过测试与Altera FFT IP相当-FFT Verilog RTL Altera FFT IP
Update : 2025-02-17 Size : 8kb Publisher : liu
[VHDL-FPGA-Verilog] fft_test DL : 0: ALTERA的FFT IP核时序的仿真，verilog语言。采用burst方式，FFT点数2048点-FFT IP core of timing simulation ALTERA, verilog language. Using burst mode, FFT points 2048 points
Update : 2025-02-17 Size : 24.44mb Publisher : vincentspace
[VHDL-FPGA-Verilog] Altera FFT IP核使用实例 DL : 0: Verilog，关于如何调用Altera官方的FFT iP核，如何输入和得到输出的实例。
Update : 2015-04-09 Size : 9.58kb Publisher : dumn1234
[VHDL-FPGA-Verilog] FFT DL : 0: verilog xilinx IP实现FFT仿真-Verilog xilinx IP implementation FFT simulation
Update : 2025-02-17 Size : 2.84mb Publisher : 欧阳
[Other] FFT v1 DL : 0: IP core fft verilog code example
Update : 2025-02-17 Size : 5.5mb Publisher : mrv

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