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[Other resourceintro_to_quartus2_v6.0_chinese

Description: quartus II 6.0 中文使用手册 intro_to_quartus2_chinese-Chinese quartus II 6.0 manual intro_to_quartus2_ english
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[Other resourceCrack_QII60_b178

Description: Quartus II 6.0完全Crack文件-Quartus II 6.0 document completely Crack
Platform: | Size: 6319 | Author: 江纵海 | Hits:

[Other resource38encode

Description: 三八译码器的源代码,在quartus II 6.0中进行进行设计的,有vhdl源代码-March 8 decoder source code, in quartus II 6.0 for the design, Source code is vhdl
Platform: | Size: 152173 | Author: 孙彤 | Hits:

[Other resourceSVGA_quartus

Description: 在开发板上实现svga条形信号发生器的源代码,是在quartus II 6.0的开发环境中运行的-achieved in the development of board svga strip signal generator source code, in quartus II 6.0 development environment running on
Platform: | Size: 214855 | Author: 孙彤 | Hits:

[Other resource8051-vhdl-code

Description: 单片机8051 IP内核的VHDL源码,需要的开发环境QUARTUS II 6.0。
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[Other resource6-portRegisterFile

Description: 6端口寄存器IP内核VHDL源代码,所需的开发环境是QUARTUS II 6.0。
Platform: | Size: 29429 | Author: 周华茂 | Hits:

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Description: BIST 电路IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
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[Other resourceSoC_WishboneSystem

Description: SoC-Wishbone System IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
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Description: ARM7系统IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
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Description: 键盘控制电路IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
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Description: SDRAM控制IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
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[Other resourceQuartusII

Description: 介绍Quartus II 6.0使用指南。哈尔滨工程大学信息与通信工程学院
Platform: | Size: 861269 | Author: zb | Hits:

[Other resourcefifo8_8

Description: 8*8位的fifo数据缓冲器的vhdl源程序。经过quartus ii 6.0 验证成功。
Platform: | Size: 1088 | Author: 李松 | Hits:

[Other4_in_1

Description: 骏龙提供的最新quartus8.0的license,包括Quartus II 8.0,NIOS II 8.0(在Quartus II的license里面),DSP Builde 8.0,ModelSim-Altera 6.1g (Quartus II 8.0),新Quartus II的license支持远程桌面访问的功能。
Platform: | Size: 333553 | Author: 王网 | Hits:

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Description: 使用Quartus II设计并制作一台出租车计价器不同情况具有不同的收费标准行驶公里: 在行车三千米以内时,按起步价10元收费,超过3千米部分,以每千米1.6元计算。 l 途中等待(>2min 开始收费) 在等待时间小于2分钟以内时不收取额外费用,大于2分钟,按每分钟1.5元计算。
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Description: 本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程,作为我这一段 时间自学 FPGA/CPLD 的总结,如果有什么不正确的地方,敬请各位不幸看到这篇文章的 大侠们指正,在此表示感谢。当然,这是一个非常简单的时序逻辑电路实例,主要是详细 描述了一些软件的使用方法。文章中涉及的软件有Synplicity 公司出品的Synplify Pro 7.7.1; Altera 公司出品的 Quartus II 4.2;Mentor Graphics 公司出品的 ModelSim SE 6.0。
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[VHDL-FPGA-Verilogquartus II中文用户教程(英文版的完全翻译)

Description: quartus II中文用户教程(英文版的完全翻译),和一切爱好可编程器件的同仁共勉之-Quartus II Chinese user guide (English version of the full translation) love and all programmable devices colleagues share Zhi
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[Software Engineeringintro_to_quartus2_v6.0_chinese

Description: quartus II 6.0 中文使用手册 intro_to_quartus2_chinese-Chinese quartus II 6.0 manual intro_to_quartus2_ english
Platform: | Size: 2068480 | Author: yysh | Hits:

[source in ebookCrack_QII60_b178

Description: Quartus II 6.0完全Crack文件-Quartus II 6.0 document completely Crack
Platform: | Size: 6144 | Author: 江纵海 | Hits:

[VHDL-FPGA-VerilogQuartus II 6.0 Handbook

Description: Altera's Quartus II 6.0 Handbook
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