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[Editor] xapp514_hd-integ-demobrd DL : 0: SDI接口的源程序,包括扰码编码,并串转换,用VHDL硬件描述语言编写-SDI interface of the source, including interference coding and string conversion, using VHDL hardware description language
Update : 2008-10-13 Size : 373.09kb Publisher : 李西军
[Editor] xapp514_hd-integ-demobrd DL : 0: SDI接口的源程序,包括扰码编码,并串转换,用VHDL硬件描述语言编写-SDI interface of the source, including interference coding and string conversion, using VHDL hardware description language
Update : 2025-02-17 Size : 373kb Publisher :
[Other systems] sdi_receive DL : 0: 本程序是关于SDI 接口的描述，以用FPGA代替相关芯片； sdi_receive-This procedure is described on the SDI interface to use in place of the relevant FPGA chip sdi_receive
Update : 2025-02-17 Size : 11kb Publisher : fyge_free
[Other systems] sdi_transmit DL : 0: 本程序是关于SDI 接口的描述，以用FPGA代替相关芯片； sdi_transmit-This procedure is described on the SDI interface to use in place of the relevant FPGA chip sdi_transmit
Update : 2025-02-17 Size : 22kb Publisher : fyge_free
[VHDL-FPGA-Verilog] IPcore DL : 0: 基于EP3C25的Altera SDI IP核的使用-EP3C25 Altera SDI IP
Update : 2025-02-17 Size : 1.42mb Publisher : wzk
[VHDL-FPGA-Verilog] xapp288 DL : 0: This the reference design file for XAPP288 " SDI Video Decoder" it includes both VHDL and Verilog versions -This is the reference design file for XAPP288 " SDI Video Decoder" it includes both VHDL and Verilog versions
Update : 2025-02-17 Size : 67kb Publisher : zhangxinxin
[VHDL-FPGA-Verilog] sd_hd_sdi_demo DL : 0: lattice的SDI DEMO板工程源代码，HD/SD自适应，内有彩条自产生源-designed for lattice sdi
Update : 2025-02-17 Size : 777kb Publisher : lqj
[Other Embeded program] SPI DL : 0: SPI（Serial Peripheral Interface）是一种串行同步通讯协议，由一个主设备和一个或多个从设备组成，主设备启动一个与从设备的同步通讯，从而完成数据的交换。SPI 接口由SDI（串行数据输入），SDO（串行数据输出），SCK（串行移位时钟），CS（从使能信号）四种信号构成，CS 决定了唯一的与主设备通信的从设备，如没有CS 信号，则只能存在一个从设备，主设备通过产生移位时钟来发起通讯。通讯时，数据由SDO 输出，SDI 输入，数据在时钟的上升或下降沿由SDO 输出，在紧接着的下降或上升沿由SDI 读入，这样经过8/16 次时钟的改变，完成8/16 位数据的传输。-/ SPI协议中的McBSP时钟停止模式 SPI协议是以主从方式工作的，这种模式通常有一个主设备和一个或多个从设备，其接口包括以下四种信号：（1）串行数据输入（也称为主进从出，或MISO）；（2）串行数据输出（也称为主出从进，或MOSI）；（3）串行移位时钟（也称为SCK）；（4）从使能信号（也称为SS）。
Update : 2025-02-17 Size : 1kb Publisher : 王静
[VHDL-FPGA-Verilog] SDI_PassThr_SZ DL : 0: Xilinx SDI参考设计，Verilog/VHDL源代码和相关文档等-Xilinx SDI pass through Verilog/VHDL source code
Update : 2025-02-17 Size : 4.7mb Publisher : 黄棋波
[VHDL-FPGA-Verilog] xapp1015 DL : 0: SDI接口的VHDL实现，XILINX官网的设计参考-SDI interface VHDL realize XILINX official website design reference
Update : 2025-02-17 Size : 596kb Publisher : 王凯