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Downloads SourceCode Embeded-SCM Develop VHDL-FPGA-Verilog
Title: buttons Download
 Description: fpga verilog abc buttons
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8、按键
.......\db
.......\..\NOT_G.asm.qmsg
.......\..\NOT_G.asm_labs.ddb
.......\..\NOT_G.cbx.xml
.......\..\NOT_G.cmp.cdb
.......\..\NOT_G.cmp.hdb
.......\..\NOT_G.cmp.kpt
.......\..\NOT_G.cmp.logdb
.......\..\NOT_G.cmp.rdb
.......\..\NOT_G.cmp.tdb
.......\..\NOT_G.cmp0.ddb
.......\..\NOT_G.db_info
.......\..\NOT_G.eco.cdb
.......\..\NOT_G.fit.qmsg
.......\..\NOT_G.hier_info
.......\..\NOT_G.hif
.......\..\NOT_G.lpc.html
.......\..\NOT_G.lpc.rdb
.......\..\NOT_G.lpc.txt
.......\..\NOT_G.map.cdb
.......\..\NOT_G.map.hdb
.......\..\NOT_G.map.logdb
.......\..\NOT_G.map.qmsg
.......\..\NOT_G.pre_map.cdb
.......\..\NOT_G.pre_map.hdb
.......\..\NOT_G.rtlv.hdb
.......\..\NOT_G.rtlv_sg.cdb
.......\..\NOT_G.rtlv_sg_swap.cdb
.......\..\NOT_G.sgdiff.cdb
.......\..\NOT_G.sgdiff.hdb
.......\..\NOT_G.sld_design_entry.sci
.......\..\NOT_G.sld_design_entry_dsc.sci
.......\..\NOT_G.syn_hier_info
.......\..\NOT_G.tan.qmsg
.......\..\NOT_G.tis_db_list.ddb
.......\..\NOT_G.tmw_info
.......\..\prev_cmp_NOT_G.asm.qmsg
.......\..\prev_cmp_NOT_G.fit.qmsg
.......\..\prev_cmp_NOT_G.map.qmsg
.......\..\prev_cmp_NOT_G.qmsg
.......\..\prev_cmp_NOT_G.tan.qmsg
.......\incremental_db
.......\..............\compiled_partitions
.......\..............\...................\NOT_G.root_partition.map.kpt
.......\..............\README
.......\NOT_G.asm.rpt
.......\NOT_G.cdf
.......\NOT_G.done
.......\NOT_G.dpf
.......\NOT_G.fit.rpt
.......\NOT_G.fit.smsg
.......\NOT_G.fit.summary
.......\NOT_G.flow.rpt
.......\NOT_G.map.rpt
.......\NOT_G.map.summary
.......\NOT_G.pin
.......\NOT_G.pof
.......\NOT_G.qpf
.......\NOT_G.qsf
.......\NOT_G.qws
.......\NOT_G.tan.rpt
.......\NOT_G.tan.summary
.......\NOT_G.v
.......\NOT_G.v.bak
.......\NOT_G_description.txt
    

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